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Altium Designer 17(PCB設(shè)計(jì)軟件)發(fā)布

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發(fā)表于 2016-12-4 17:04:32 | 只看該作者 |只看大圖 回帖獎(jiǎng)勵(lì) |倒序?yàn)g覽 |閱讀模式
電路設(shè)計(jì)自動(dòng)化 EDA(Electronic Design Automation)指的就是將電路設(shè)計(jì)中各種工作交由計(jì)算機(jī)來協(xié)助完成。如電路原理圖(Schematic)的繪制、印刷電路板(PCB)文件的制作、執(zhí)行電路仿真(Simulation)等設(shè)計(jì)工作。隨著電子科技的蓬勃發(fā)展,新型元器件層出不窮,電子線路變得越來越復(fù)雜,電路的設(shè)計(jì)工作已經(jīng)無法單純依靠手工來完成,電子線路計(jì)算機(jī)輔助設(shè)計(jì)已經(jīng)成為必然趨勢(shì),越來越多的設(shè)計(jì)人員使用快捷、高效的CAD設(shè)計(jì)軟件來進(jìn)行輔助電路原理圖、印制電路板圖的設(shè)計(jì),打印各種報(bào)表。
+ i  k7 w. X/ B3 ?! ^7 iAltium Designer 是原Protel軟件開發(fā)商Altium公司推出的一體化的電子產(chǎn)品開發(fā)系統(tǒng),主要運(yùn)行在Windows操作系統(tǒng)。這套軟件通過把原理圖設(shè)計(jì)、電路仿真、PCB繪制編輯、拓?fù)溥壿嬜詣?dòng)布線、信號(hào)完整性分析和設(shè)計(jì)輸出等技術(shù)的完美融合,為設(shè)計(jì)者提供了全新的設(shè)計(jì)解決方案,使設(shè)計(jì)者可以輕松進(jìn)行設(shè)計(jì),熟練使用這一軟件必將使電路設(shè)計(jì)的質(zhì)量和效率大大提高。; d! E* o- L  _2 X5 J, c
Altium Designer 除了全面繼承包括Protel 99SE、Protel DXP在內(nèi)的先前一系列版本的功能和優(yōu)點(diǎn)外,還增加了許多改進(jìn)和很多高端功能。該平臺(tái)拓寬了板級(jí)設(shè)計(jì)的傳統(tǒng)界面,全面集成了FPGA設(shè)計(jì)功能和SOPC設(shè)計(jì)實(shí)現(xiàn)功能,從而允許工程設(shè)計(jì)人員能將系統(tǒng)設(shè)計(jì)中的FPGA與PCB設(shè)計(jì)及嵌入式設(shè)計(jì)集成在一起。
+ M+ f8 n5 z0 h% M) ], [
/ {; J7 a; T. d. b7 U3 i; i17新增功能包括:7 V7 E6 p9 T& Y1 p) Q$ p2 M
ACTIVEROUTE
PCB設(shè)計(jì)階段,我們將大量的時(shí)間精力耗費(fèi)在了PCB布線這個(gè)環(huán)節(jié),成千上萬個(gè)網(wǎng)絡(luò),不斷的打孔換層修線繞線,有時(shí)還得將之前布好的線刪除重走,真心是一個(gè)累字。阿爾法狗下圍棋都能戰(zhàn)勝人類了,那在pcb布線這一塊,能不能也實(shí)現(xiàn)人工智能來實(shí)現(xiàn)自動(dòng)布線呢?很可惜,目前還沒有,不過EDA廠商們正在不斷努力完善軟件的自動(dòng)布線功能,Altium Designer 17 帶來的新的ActiveRoute功能能極大地將我們從繁重的拉線活中解放出來。
ActiveRoute 是一種交互式自動(dòng)布線技術(shù),可以進(jìn)行高速、多網(wǎng)絡(luò)、多層的網(wǎng)絡(luò)自動(dòng)布線功能。ActiveRoute 允許我們交互式的針對(duì)一組網(wǎng)絡(luò)進(jìn)行自動(dòng)布線,在滿足設(shè)計(jì)規(guī)則的條件下,通過設(shè)計(jì)師的一些簡(jiǎn)單的控制,就能將一組關(guān)聯(lián)的網(wǎng)絡(luò)走線快速并且高質(zhì)量的布通,最大化的釋放我們的勞動(dòng)力。
以前我們覺得自動(dòng)布線功能是雞肋,只能在一些非關(guān)鍵的簡(jiǎn)單的網(wǎng)絡(luò)上應(yīng)用,并且最終自動(dòng)布線完成后,還要人工去修線,現(xiàn)在,ActiveRoute 的新功能足以讓人們改變這種看法。
) V+ v9 v. D! n! _- @6 L
背鉆孔
通過對(duì)鉆孔的完全控制,減少高速設(shè)計(jì)時(shí)對(duì)信號(hào)完整性的干擾
跟蹤修線
運(yùn)用布線路徑自動(dòng)對(duì)準(zhǔn)功能,輕松優(yōu)化PCB網(wǎng)絡(luò)的長(zhǎng)度和質(zhì)量
  網(wǎng)絡(luò)顏色同步) C8 o& P" ]- ]' a: ^4 h8 Q
  通過原理圖設(shè)計(jì)和PCB布線之間的網(wǎng)絡(luò)顏色同步,確保文檔的準(zhǔn)確性和可視性。通過可控的ECO指令,即時(shí)同步網(wǎng)絡(luò)顏色到PCB布線中。. H% g5 Y# _8 D2 d$ ~+ _. _; C% I# m! V1 |
  TECHNOLOGY- AWARE XSIGNALS 向?qū)?br /> 4 G0 T& _0 U/ P3 z% O  利用先進(jìn)的xSignals向?qū)Вp松準(zhǔn)確地設(shè)計(jì)高速電路板。為DDR3自動(dòng)創(chuàng)建xSignals分類并匹配長(zhǎng)度規(guī)則。
, i' |! }1 u/ r, Z  ^  元件布局系統(tǒng)
% x+ P0 P: t: P$ v- }  應(yīng)用新的元件布局系統(tǒng),高效應(yīng)對(duì)板卡設(shè)計(jì)。在板卡設(shè)計(jì)時(shí),可以動(dòng)態(tài)放置和拖拽元件,并進(jìn)行推擠、避讓或與其它元件對(duì)齊。9 O( t0 S" }: S
  可視化間距邊界
7 m- h7 V1 v' o! U) u, l3 _  通過可視化間距邊界功能,可以實(shí)時(shí)清晰地查看布線策略的影響。在走線時(shí)可以看到走線和元件之間的距離間隙,輕松應(yīng)對(duì)高密板。) V: v# o+ W7 \- S$ s! R! D8 j, D
  3D STEP模型生成向?qū)?font class="jammer">+ X- u0 L  @7 N) H* z
  使用3D STEP模型生成向?qū)лp松生成最真實(shí)、準(zhǔn)確和數(shù)據(jù)豐富的3D模型。將您的實(shí)體電路板精確體現(xiàn)在實(shí)時(shí)原生3D PCB上。
& ~' G/ g& {+ T' V  增強(qiáng)的引腳長(zhǎng)度定義5 ]" e3 s+ Q5 p" y& l# f
  使用在元器件引腳屬性中增強(qiáng)的引腳長(zhǎng)度定義來精準(zhǔn)高效地進(jìn)行高速設(shè)計(jì)布線。增強(qiáng)的引腳長(zhǎng)度計(jì)算功能包括了芯片內(nèi)部連接導(dǎo)線的長(zhǎng)度,無需進(jìn)行耗時(shí)的手動(dòng)計(jì)算。
5 s$ K5 C- c& T4 |  E1 G" C0 U  PADS LOGIC 導(dǎo)出器
3 P/ Q( m% v7 {) U$ U  應(yīng)用 PADS? Logic導(dǎo)出器,將設(shè)計(jì)數(shù)據(jù)從Altium Designer導(dǎo)出到PADS?,節(jié)約您的設(shè)計(jì)時(shí)間。應(yīng)用Altium Designer進(jìn)行高級(jí)版圖設(shè)計(jì),之后即時(shí)將原理圖和PCB版圖導(dǎo)入到PADS? 中。; T1 ]2 s# S( ^5 f- U* t7 }
  孔公差定義9 z+ ?% H7 o; [7 N4 I+ [# }: v
  為焊盤和過孔定義特定的公差值,確保PCB制造的可靠性。指定精確的孔公差,并將其作為生產(chǎn)數(shù)據(jù)的一部分,確保每次生產(chǎn)時(shí)一次通過。
! w% K- Z9 r  |& `( U1 g: \* H  高級(jí)元件搜索
6 s7 @7 h! v. R5 f6 S  在Vault瀏覽器中應(yīng)用高級(jí)查找選項(xiàng),輕松準(zhǔn)確地找到您設(shè)計(jì)中所需的元件。根據(jù)您的特定需求來定制搜索選項(xiàng),并且可以將搜索項(xiàng)收藏,以備后用。3 Y& \# n! L' B( \
  離線設(shè)計(jì)系統(tǒng)
. ~+ e9 W: J& d9 V  您通過離線設(shè)計(jì)系統(tǒng)向外界分享的網(wǎng)絡(luò)數(shù)據(jù)可以盡在您的掌控中。輕松使用Altium Designer 為指定應(yīng)用設(shè)定連接,包括您的偏好分享、許可證服務(wù)器、元器件供應(yīng)商連接等。  z8 U4 ^8 Z) v" z) \1 {9 A0 q" r4 {/ T5 G
  集成的TASKING PIN MAPPER' h6 q. {( U% K
  利用集成的TASKING Pin Mapper,隨時(shí)分享PCB與嵌入式軟件項(xiàng)目間的設(shè)計(jì)數(shù)據(jù)。 節(jié)省Altium Designer與TASKING工具之間引腳分配、處理器芯片標(biāo)識(shí)符和符號(hào)名稱的轉(zhuǎn)換時(shí)間。" W" d, Z; U0 c
  新型設(shè)計(jì)規(guī)則編輯器4 ^7 j0 Z2 X  ~  K  \- e/ G3 e
  應(yīng)用新的設(shè)計(jì)規(guī)則編輯器,可以輕松創(chuàng)建和管理高級(jí)設(shè)計(jì)規(guī)則。通過合理的查詢驗(yàn)證接口,準(zhǔn)確理解查詢語(yǔ)句之間的關(guān)系,避免設(shè)計(jì)規(guī)則沖突。% r' C* D+ F' y: R4 F9 w
' a- i; `' S% H2 l: _& o
$ x1 W+ s6 N6 ~5 T% c; d0 W
http://pan.baidu.com/s/1hr4dsK8  2e2m0 q* _4 K. `) A, c" ~
內(nèi)含和諧許可證及安裝教程
4 N7 ?2 w6 P' r/ {7 k5 L" L" i0 {  Q  h
http://pan.baidu.com/s/1pL2dQ7D  g6kk8 _+ c# f% I3 h" X6 q  ?' M
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發(fā)表于 2016-12-4 17:24:31 | 只看該作者
謝謝!@寂靜天花板大俠
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發(fā)表于 2016-12-5 02:30:10 | 只看該作者
有些細(xì)節(jié)改得不如以前方便了。比如原理圖里面拖動(dòng)原件的時(shí)候旋轉(zhuǎn)。以前是不按Ctrl獨(dú)立拖動(dòng),按住之后帶線拖動(dòng)。按空格直接旋轉(zhuǎn)。現(xiàn)在反過來了,要旋轉(zhuǎn)得按Ctrl+空格。剛好Win7系統(tǒng)默認(rèn)的IME有個(gè)bug,Ctrl+空格會(huì)先觸發(fā)操作系統(tǒng)切換到中文輸入法。去語(yǔ)言選項(xiàng)更改按鍵順序沒用的,最后得到注冊(cè)表里改掉對(duì)應(yīng)IME的十六進(jìn)制值才消停。  i$ G( S5 X; k' `0 M$ K
. }5 n0 X; v, ?; v2 p) l" ~- ]
多屏環(huán)境下一些可停靠面板無端消失、亂跳的問題沿襲好幾代了,還是沒解決。
/ T% L3 L% s. h+ l; U, I: D
: [  D/ o; L0 `( r不過總體來說是更好用了。
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發(fā)表于 2016-12-5 08:28:48 | 只看該作者
謝謝樓主的分享, 頂一下

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